contrib/llvm-project/llvm/lib/Target/MSP430/MSP430RegisterInfo.td

   1 //===-- MSP430RegisterInfo.td - MSP430 Register defs -------*- tablegen -*-===//
   2 //
   3 // Part of the LLVM Project, under the Apache License v2.0 with LLVM Exceptions.
   4 // See https://llvm.org/LICENSE.txt for license information.
   5 // SPDX-License-Identifier: Apache-2.0 WITH LLVM-exception
   6 //
   7 //===----------------------------------------------------------------------===//
   8
   9 //===----------------------------------------------------------------------===//
  10 //  Declarations that describe the MSP430 register file
  11 //===----------------------------------------------------------------------===//
  12
  13 class MSP430Reg<bits<4> num, string n, list<string> alt = []> : Register<n> {
  14   field bits<4> Num = num;
  15   let Namespace = "MSP430";
  16   let HWEncoding{3-0} = num;
  17   let AltNames = alt;
  18 }
  19
  20 class MSP430RegWithSubregs<bits<4> num, string n, list<Register> subregs,
  21                            list<string> alt = []>
  22   : RegisterWithSubRegs<n, subregs> {
  23   field bits<4> Num = num;
  24   let Namespace = "MSP430";
  25   let HWEncoding{3-0} = num;
  26   let AltNames = alt;
  27 }
  28
  29 //===----------------------------------------------------------------------===//
  30 //  Registers
  31 //===----------------------------------------------------------------------===//
  32
  33 def PCB  : MSP430Reg<0,  "r0", ["pc"]>;
  34 def SPB  : MSP430Reg<1,  "r1", ["sp"]>;
  35 def SRB  : MSP430Reg<2,  "r2", ["sr"]>;
  36 def CGB  : MSP430Reg<3,  "r3", ["cg"]>;
  37 def FPB  : MSP430Reg<4,  "r4", ["fp"]>;
  38 def R5B  : MSP430Reg<5,  "r5">;
  39 def R6B  : MSP430Reg<6,  "r6">;
  40 def R7B  : MSP430Reg<7,  "r7">;
  41 def R8B  : MSP430Reg<8,  "r8">;
  42 def R9B  : MSP430Reg<9,  "r9">;
  43 def R10B : MSP430Reg<10, "r10">;
  44 def R11B : MSP430Reg<11, "r11">;
  45 def R12B : MSP430Reg<12, "r12">;
  46 def R13B : MSP430Reg<13, "r13">;
  47 def R14B : MSP430Reg<14, "r14">;
  48 def R15B : MSP430Reg<15, "r15">;
  49
  50 def subreg_8bit : SubRegIndex<8> { let Namespace = "MSP430"; }
  51
  52 let SubRegIndices = [subreg_8bit] in {
  53 def PC  : MSP430RegWithSubregs<0,  "r0",  [PCB], ["pc"]>;
  54 def SP  : MSP430RegWithSubregs<1,  "r1",  [SPB], ["sp"]>;
  55 def SR  : MSP430RegWithSubregs<2,  "r2",  [SRB], ["sr"]>;
  56 def CG  : MSP430RegWithSubregs<3,  "r3",  [CGB], ["cg"]>;
  57 def FP  : MSP430RegWithSubregs<4,  "r4",  [FPB], ["fp"]>;
  58 def R5  : MSP430RegWithSubregs<5,  "r5",  [R5B]>;
  59 def R6  : MSP430RegWithSubregs<6,  "r6",  [R6B]>;
  60 def R7  : MSP430RegWithSubregs<7,  "r7",  [R7B]>;
  61 def R8  : MSP430RegWithSubregs<8,  "r8",  [R8B]>;
  62 def R9  : MSP430RegWithSubregs<9,  "r9",  [R9B]>;
  63 def R10 : MSP430RegWithSubregs<10, "r10", [R10B]>;
  64 def R11 : MSP430RegWithSubregs<11, "r11", [R11B]>;
  65 def R12 : MSP430RegWithSubregs<12, "r12", [R12B]>;
  66 def R13 : MSP430RegWithSubregs<13, "r13", [R13B]>;
  67 def R14 : MSP430RegWithSubregs<14, "r14", [R14B]>;
  68 def R15 : MSP430RegWithSubregs<15, "r15", [R15B]>;
  69 }
  70
  71 def GR8 : RegisterClass<"MSP430", [i8], 8,
  72    // Volatile registers
  73   (add R12B, R13B, R14B, R15B, R11B, R10B, R9B, R8B, R7B, R6B, R5B,
  74    // Frame pointer, sometimes allocable
  75    FPB,
  76    // Volatile, but not allocable
  77    PCB, SPB, SRB, CGB)>;
  78
  79 def GR16 : RegisterClass<"MSP430", [i16], 16,
  80    // Volatile registers
  81   (add R12, R13, R14, R15, R11, R10, R9, R8, R7, R6, R5,
  82    // Frame pointer, sometimes allocable
  83    FP,
  84    // Volatile, but not allocable
  85    PC, SP, SR, CG)>;