sys/arm/arm/cpufunc_asm_armv6.S

   1 /*      $NetBSD: cpufunc_asm_armv6.S,v 1.4 2010/12/10 02:06:22 bsh Exp $        */
   2
   3 /*
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  30  * SUCH DAMAGE.
  31  *
  32  * ARMv6 assembly functions for manipulating caches.
  33  * These routines can be used by any core that supports the mcrr address
  34  * range operations.
  35  */
  36
  37 /*
  38  * $FreeBSD$
  39  */
  40
  41 #include <machine/asm.h>
  42
  43         .arch   armv6
  44
  45 /*
  46  * Functions to set the MMU Translation Table Base register
  47  *
  48  * We need to clean and flush the cache as it uses virtual
  49  * addresses that are about to change.
  50  */
  51 ENTRY(armv6_setttb)
  52         mcr     p15, 0, r0, c7, c10, 4  /* drain the write buffer */
  53
  54         mcr     p15, 0, r0, c2, c0, 0   /* load new TTB */
  55
  56         mcr     p15, 0, r0, c8, c7, 0   /* invalidate I+D TLBs */
  57         RET
  58 END(armv6_setttb)
  59
  60 /*
  61  * Cache operations.
  62  */
  63
  64 /* LINTSTUB: void armv6_dcache_wb_range(vaddr_t, vsize_t); */
  65 ENTRY(armv6_dcache_wb_range)
  66         add     r1, r1, r0
  67         sub     r1, r1, #1
  68         mcrr    p15, 0, r1, r0, c12     /* clean D cache range */
  69         mcr     p15, 0, r0, c7, c10, 4  /* drain the write buffer */
  70         RET
  71 END(armv6_dcache_wb_range)
  72
  73 /* LINTSTUB: void armv6_dcache_wbinv_range(vaddr_t, vsize_t); */
  74 ENTRY(armv6_dcache_wbinv_range)
  75         add     r1, r1, r0
  76         sub     r1, r1, #1
  77         mcrr    p15, 0, r1, r0, c14     /* clean and invaliate D cache range */
  78         mcr     p15, 0, r0, c7, c10, 4  /* drain the write buffer */
  79         RET
  80 END(armv6_dcache_wbinv_range)
  81
  82 /*
  83  * Note, we must not invalidate everything.  If the range is too big we
  84  * must use wb-inv of the entire cache.
  85  *
  86  * LINTSTUB: void armv6_dcache_inv_range(vaddr_t, vsize_t);
  87  */
  88 ENTRY(armv6_dcache_inv_range)
  89         add     r1, r1, r0
  90         sub     r1, r1, #1
  91         mcrr    p15, 0, r1, r0, c6      /* invaliate D cache range */
  92         mcr     p15, 0, r0, c7, c10, 4  /* drain the write buffer */
  93         RET
  94 END(armv6_dcache_inv_range)
  95
  96 /* LINTSTUB: void armv6_idcache_wbinv_all(void); */
  97 ENTRY_NP(armv6_idcache_wbinv_all)
  98         /*
  99          * We assume that the code here can never be out of sync with the
 100          * dcache, so that we can safely flush the Icache and fall through
 101          * into the Dcache purging code.
 102          */
 103         mcr     p15, 0, r0, c7, c5, 0   /* Flush I cache */
 104
 105         /* Purge Dcache. */
 106         mcr     p15, 0, r0, c7, c14, 0  /* clean & invalidate D cache */
 107         mcr     p15, 0, r0, c7, c10, 4  /* drain the write buffer */
 108         RET
 109 END(armv6_idcache_wbinv_all)
 110
 111 ENTRY(armv6_idcache_inv_all)
 112         mov     r0, #0
 113         mcr     p15, 0, r0, c7, c7, 0   /* invalidate all I+D cache */
 114         RET
 115 END(armv6_idcache_inv_all)
 116