sys/arm/include/cpuconf.h

   1 /*      $NetBSD: cpuconf.h,v 1.8 2003/09/06 08:55:42 rearnsha Exp $     */
   2
   3 /*-
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  35  * POSSIBILITY OF SUCH DAMAGE.
  36  *
  37  * $FreeBSD$
  38  *
  39  */
  40
  41 #ifndef _MACHINE_CPUCONF_H_
  42 #define _MACHINE_CPUCONF_H_
  43
  44 /*
  45  * IF YOU CHANGE THIS FILE, MAKE SURE TO UPDATE THE DEFINITION OF
  46  * "PMAP_NEEDS_PTE_SYNC" IN <arm/arm32/pmap.h> FOR THE CPU TYPE
  47  * YOU ARE ADDING SUPPORT FOR.
  48  */
  49
  50 /*
  51  * Step 1: Count the number of CPU types configured into the kernel.
  52  */
  53 #define CPU_NTYPES      (defined(CPU_ARM7TDMI) +                        \
  54                          defined(CPU_ARM8) + defined(CPU_ARM9) +        \
  55                          defined(CPU_ARM9E) +                           \
  56                          defined(CPU_ARM10) +                           \
  57                          defined(CPU_ARM11) +                           \
  58                          defined(CPU_SA110) + defined(CPU_SA1100) +     \
  59                          defined(CPU_SA1110) +                          \
  60                          defined(CPU_IXP12X0) +                         \
  61                          defined(CPU_XSCALE_80200) +                    \
  62                          defined(CPU_XSCALE_80321) +                    \
  63                          defined(CPU_XSCALE_PXA2X0) +                   \
  64                          defined(CPU_FA526) +                           \
  65                          defined(CPU_XSCALE_IXP425))
  66
  67 /*
  68  * Step 2: Determine which ARM architecture versions are configured.
  69  */
  70 #if (defined(CPU_ARM7TDMI) || defined(CPU_ARM8) || defined(CPU_ARM9) || \
  71      defined(CPU_SA110) || defined(CPU_SA1100) || defined(CPU_SA1110) || \
  72      defined(CPU_IXP12X0) || defined(CPU_XSCALE_IXP425) || defined(CPU_FA526))
  73 #define ARM_ARCH_4      1
  74 #else
  75 #define ARM_ARCH_4      0
  76 #endif
  77
  78 #if (defined(CPU_ARM9E) || defined(CPU_ARM10) ||                        \
  79      defined(CPU_XSCALE_80200) || defined(CPU_XSCALE_80321) ||          \
  80      defined(CPU_XSCALE_80219) || defined(CPU_XSCALE_81342) ||          \
  81      defined(CPU_XSCALE_PXA2X0))
  82 #define ARM_ARCH_5      1
  83 #else
  84 #define ARM_ARCH_5      0
  85 #endif
  86
  87 #if defined(CPU_ARM11)
  88 #define ARM_ARCH_6      1
  89 #else
  90 #define ARM_ARCH_6      0
  91 #endif
  92
  93 #define ARM_NARCH       (ARM_ARCH_4 + ARM_ARCH_5 + ARM_ARCH_6)
  94 #if ARM_NARCH == 0 && !defined(KLD_MODULE) && defined(_KERNEL)
  95 #error ARM_NARCH is 0
  96 #endif
  97
  98 #if ARM_ARCH_5 || ARM_ARCH_6
  99 /*
 100  * We could support Thumb code on v4T, but the lack of clean interworking
 101  * makes that hard.
 102  */
 103 #define THUMB_CODE
 104 #endif
 105
 106 /*
 107  * Step 3: Define which MMU classes are configured:
 108  *
 109  *      ARM_MMU_MEMC            Prehistoric, external memory controller
 110  *                              and MMU for ARMv2 CPUs.
 111  *
 112  *      ARM_MMU_GENERIC         Generic ARM MMU, compatible with ARM6.
 113  *
 114  *      ARM_MMU_SA1             StrongARM SA-1 MMU.  Compatible with generic
 115  *                              ARM MMU, but has no write-through cache mode.
 116  *
 117  *      ARM_MMU_XSCALE          XScale MMU.  Compatible with generic ARM
 118  *                              MMU, but also has several extensions which
 119  *                              require different PTE layout to use.
 120  */
 121 #if (defined(CPU_ARM2) || defined(CPU_ARM250) || defined(CPU_ARM3))
 122 #define ARM_MMU_MEMC            1
 123 #else
 124 #define ARM_MMU_MEMC            0
 125 #endif
 126
 127 #if (defined(CPU_ARM6) || defined(CPU_ARM7) || defined(CPU_ARM7TDMI) || \
 128      defined(CPU_ARM8) || defined(CPU_ARM9) || defined(CPU_ARM9E) ||    \
 129      defined(CPU_ARM10) || defined(CPU_ARM11) || defined(CPU_FA526))
 130 #define ARM_MMU_GENERIC         1
 131 #else
 132 #define ARM_MMU_GENERIC         0
 133 #endif
 134
 135 #if (defined(CPU_SA110) || defined(CPU_SA1100) || defined(CPU_SA1110) ||\
 136      defined(CPU_IXP12X0))
 137 #define ARM_MMU_SA1             1
 138 #else
 139 #define ARM_MMU_SA1             0
 140 #endif
 141
 142 #if(defined(CPU_XSCALE_80200) || defined(CPU_XSCALE_80321) ||           \
 143     defined(CPU_XSCALE_PXA2X0) || defined(CPU_XSCALE_IXP425) ||         \
 144     defined(CPU_XSCALE_80219)) || defined(CPU_XSCALE_81342)
 145 #define ARM_MMU_XSCALE          1
 146 #else
 147 #define ARM_MMU_XSCALE          0
 148 #endif
 149
 150 #define ARM_NMMUS               (ARM_MMU_MEMC + ARM_MMU_GENERIC +       \
 151                                  ARM_MMU_SA1 + ARM_MMU_XSCALE)
 152 #if ARM_NMMUS == 0 && !defined(KLD_MODULE) && defined(_KERNEL)
 153 #error ARM_NMMUS is 0
 154 #endif
 155
 156 /*
 157  * Step 4: Define features that may be present on a subset of CPUs
 158  *
 159  *      ARM_XSCALE_PMU          Performance Monitoring Unit on 80200 and 80321
 160  */
 161
 162 #if (defined(CPU_XSCALE_80200) || defined(CPU_XSCALE_80321) || \
 163      defined(CPU_XSCALE_80219)) || defined(CPU_XSCALE_81342)
 164 #define ARM_XSCALE_PMU  1
 165 #else
 166 #define ARM_XSCALE_PMU  0
 167 #endif
 168
 169 #if defined(CPU_XSCALE_81342)
 170 #define CPU_XSCALE_CORE3
 171 #endif
 172 #endif /* _MACHINE_CPUCONF_H_ */