sys/sparc64/sparc64/cheetah.c

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  24  * SUCH DAMAGE.
  25  */
  26
  27 #include <sys/cdefs.h>
  28 __FBSDID("$FreeBSD$");
  29
  30 #include "opt_pmap.h"
  31
  32 #include <sys/param.h>
  33 #include <sys/linker_set.h>
  34 #include <sys/proc.h>
  35 #include <sys/lock.h>
  36 #include <sys/mutex.h>
  37 #include <sys/smp.h>
  38 #include <sys/sysctl.h>
  39 #include <sys/systm.h>
  40
  41 #include <vm/vm.h>
  42 #include <vm/pmap.h>
  43
  44 #include <machine/cache.h>
  45 #include <machine/cpufunc.h>
  46 #include <machine/smp.h>
  47 #include <machine/tlb.h>
  48
  49 /*
  50  * Enable level 1 caches.
  51  */
  52 void
  53 cheetah_cache_enable(void)
  54 {
  55
  56 }
  57
  58 /*
  59  * Flush all lines from the level 1 caches.
  60  */
  61 void
  62 cheetah_cache_flush(void)
  63 {
  64
  65 }
  66
  67 /*
  68  * Flush a physical page from the data cache.
  69  */
  70 void
  71 cheetah_dcache_page_inval(vm_paddr_t spa)
  72 {
  73         vm_paddr_t pa;
  74         void *cookie;
  75
  76         KASSERT((spa & PAGE_MASK) == 0,
  77             ("dcache_page_inval: pa not page aligned"));
  78         cookie = ipi_dcache_page_inval(tl_ipi_cheetah_dcache_page_inval, spa);
  79         for (pa = spa; pa < spa + PAGE_SIZE; pa += cache.dc_linesize)
  80                 stxa_sync(pa, ASI_DCACHE_INVALIDATE, 0);
  81         ipi_wait(cookie);
  82 }
  83
  84 /*
  85  * Flush a physical page from the intsruction cache.  Instruction cache
  86  * consistency is maintained by hardware.
  87  */
  88 void
  89 cheetah_icache_page_inval(vm_paddr_t pa)
  90 {
  91
  92 }
  93
  94 /*
  95  * Flush all non-locked mappings from the TLB.
  96  */
  97 void
  98 cheetah_tlb_flush_nonlocked(void)
  99 {
 100
 101         panic("cheetah_tlb_flush_nonlocked");
 102 }
 103
 104 /*
 105  * Flush all user mappings from the TLB.
 106  */
 107 void
 108 cheetah_tlb_flush_user(void)
 109 {
 110
 111         panic("cheetah_tlb_flush_user");
 112 }