test/MC/AArch64/SVE/ld3d-diagnostics.s

   1 // RUN: not llvm-mc -triple=aarch64 -show-encoding -mattr=+sve  2>&1 < %s| FileCheck %s
   2
   3
   4 // --------------------------------------------------------------------------//
   5 // Immediate out of lower bound [-24, 21].
   6
   7 ld3d {z12.d, z13.d, z14.d}, p4/z, [x12, #-27, MUL VL]
   8 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: index must be a multiple of 3 in range [-24, 21].
   9 // CHECK-NEXT: ld3d {z12.d, z13.d, z14.d}, p4/z, [x12, #-27, MUL VL]
  10 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  11
  12 ld3d {z7.d, z8.d, z9.d}, p3/z, [x1, #24, MUL VL]
  13 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: index must be a multiple of 3 in range [-24, 21].
  14 // CHECK-NEXT: ld3d {z7.d, z8.d, z9.d}, p3/z, [x1, #24, MUL VL]
  15 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  16
  17
  18 // --------------------------------------------------------------------------//
  19 // Immediate not a multiple of three.
  20
  21 ld3d {z12.d, z13.d, z14.d}, p4/z, [x12, #-7, MUL VL]
  22 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: index must be a multiple of 3 in range [-24, 21].
  23 // CHECK-NEXT: ld3d {z12.d, z13.d, z14.d}, p4/z, [x12, #-7, MUL VL]
  24 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  25
  26 ld3d {z7.d, z8.d, z9.d}, p3/z, [x1, #5, MUL VL]
  27 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: index must be a multiple of 3 in range [-24, 21].
  28 // CHECK-NEXT: ld3d {z7.d, z8.d, z9.d}, p3/z, [x1, #5, MUL VL]
  29 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  30
  31
  32 // --------------------------------------------------------------------------//
  33 // Invalid scalar + scalar addressing modes
  34
  35 ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, x0]
  36 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: register must be x0..x30 with required shift 'lsl #3'
  37 // CHECK-NEXT: ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, x0]
  38 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  39
  40 ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, xzr]
  41 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: register must be x0..x30 with required shift 'lsl #3'
  42 // CHECK-NEXT: ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, xzr]
  43 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  44
  45 ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, x0, lsl #2]
  46 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: register must be x0..x30 with required shift 'lsl #3'
  47 // CHECK-NEXT: ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, x0, lsl #2]
  48 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  49
  50 ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, w0]
  51 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: register must be x0..x30 with required shift 'lsl #3'
  52 // CHECK-NEXT: ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, w0]
  53 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  54
  55 ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, w0, uxtw]
  56 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: register must be x0..x30 with required shift 'lsl #3'
  57 // CHECK-NEXT: ld3d { z0.d, z1.d, z2.d }, p0/z, [x0, w0, uxtw]
  58 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  59
  60
  61 // --------------------------------------------------------------------------//
  62 // error: restricted predicate has range [0, 7].
  63
  64 ld3d {z2.d, z3.d, z4.d}, p8/z, [x15, #10, MUL VL]
  65 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: restricted predicate has range [0, 7].
  66 // CHECK-NEXT: ld3d {z2.d, z3.d, z4.d}, p8/z, [x15, #10, MUL VL]
  67 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  68
  69
  70 // --------------------------------------------------------------------------//
  71 // Invalid vector list.
  72
  73 ld3d { }, p0/z, [x0]
  74 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: vector register expected
  75 // CHECK-NEXT: ld3d { }, p0/z, [x0]
  76 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  77
  78 ld3d { z0.d, z1.d, z2.d, z3.d }, p0/z, [x0]
  79 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: invalid operand
  80 // CHECK-NEXT: ld3d { z0.d, z1.d, z2.d, z3.d }, p0/z, [x0]
  81 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  82
  83 ld3d { z0.d, z1.d, z2.b }, p0/z, [x0]
  84 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: mismatched register size suffix
  85 // CHECK-NEXT: ld3d { z0.d, z1.d, z2.b }, p0/z, [x0]
  86 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  87
  88 ld3d { z0.d, z1.d, z3.d }, p0/z, [x0]
  89 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: registers must be sequential
  90 // CHECK-NEXT: ld3d { z0.d, z1.d, z3.d }, p0/z, [x0]
  91 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}:
  92
  93 ld3d { v0.2d, v1.2d, v2.2d }, p0/z, [x0]
  94 // CHECK: [[@LINE-1]]:{{[0-9]+}}: error: invalid operand
  95 // CHECK-NEXT: ld3d { v0.2d, v1.2d, v2.2d }, p0/z, [x0]
  96 // CHECK-NOT: [[@LINE-1]]:{{[0-9]+}}: